EPM7064LC68-15 IC-Chip-Programmierer Programmierbare IC-Chips Programmierbare Logikgerätefamilie

 
MAX 7000 Programmierbare Logikgerätefamilie
 
Merkmale
■ Leistungsstarke, EEPROM-basierte programmierbare Logikbausteine ​​(PLDs) basierend auf der MAX®-Architektur der zweiten Generation
■ 5,0-V-In-System-Programmierbarkeit (ISP) durch den integrierten IEEE-Standard.1149.1 Joint Test Action Group (JTAG)-Schnittstelle in MAX 7000S-Geräten verfügbar – ISP-Schaltkreis kompatibel mit IEEE Std.1532
■ Umfasst 5,0-V-MAX-7000-Geräte und 5,0-V-ISP-basierte MAX-7000S-Geräte
■ Integrierter JTAG-Boundary-Scan-Test (BST)-Schaltkreis in MAX7000S-Geräten mit 128 oder mehr Makrozellen
■ Komplette EPLD-Familie mit Logikdichten von 600 bis 5.000 nutzbaren Gattern
■ Pin-zu-Pin-Logikverzögerungen von 5 ns mit bis zu 175,4 MHz Zählerfrequenzen (einschließlich Verbindung)
■ PCI-kompatible Geräte verfügbar
■ Open-Drain-Ausgangsoption in MAX 7000S-Geräten
■ Programmierbare Makrozellen-Flipflops mit individuellen Lösch-, Voreinstellungs-, Takt- und Taktfreigabesteuerungen
■ Programmierbarer Energiesparmodus für eine Reduzierung um über 50 % in jeder Makrozelle
■ Konfigurierbare Expander-Produktbegriffsverteilung, die bis zu 32 Produktbegriffe pro Makrozelle ermöglicht
■ 44 bis 208 Pins, erhältlich in Kunststoff-J-Lead-Chip-Carrier (PLCC), Keramik-Pin-Grid-Array (PGA), Kunststoff-Quad-Flat-Pack (PQFP), Power-Quad-Flat-Pack (RQFP) und 1,0 mm dünnem Quad-Flat-Pack (TQFP)-Pakete
■ Programmierbares Sicherheitsbit zum Schutz proprietärer Designs
■ 3,3-V- oder 5,0-V-Betrieb
– MultiVoltTM-I/O-Schnittstellenbetrieb, der Geräten die Verbindung mit 3,3-V- oder 5,0-V-Geräten ermöglicht (MultiVolt-I/O-Betrieb ist in 44-Pin-Gehäusen nicht verfügbar)
– Pin-kompatibel mit Niederspannungsgeräten MAX 7000A und MAX 7000B
■ Erweiterte Funktionen verfügbar in den Geräten MAX 7000E und MAX 7000S
– Sechs pin- oder logikgesteuerte Ausgangsfreigabesignale
– Zwei globale Taktsignale mit optionaler Invertierung
– Erweiterte Verbindungsressourcen für verbesserte Routingfähigkeit
– Schnelle Eingabe-Einrichtungszeiten durch einen dedizierten Pfad vom I/O-Pin zu den Makrozellenregistern
– Programmierbare Steuerung der Ausgangsanstiegsgeschwindigkeit
■ Software-Design-Unterstützung und automatisches Place-and-Route durch Alteras Entwicklungssystem für Windows-basierte PCs und Sun SPARCstation sowie HP 9000 Series 700/800-Workstations
■ Zusätzliche Designeingabe und Simulationsunterstützung durch EDIF 2 0 0- und 3 0 0-Netzlistendateien, Bibliothek parametrisierter Module (LPM), Verilog HDL, VHDL und andere Schnittstellen zu gängigen EDA-Tools von Herstellern wie Cadence, Exemplar Logic, Mentor Grafiken, OrCAD, Synopsys und VeriBest
■ Programmierunterstützung
– Die Master Programming Unit (MPU) von Altera und Programmierhardware von Drittherstellern programmieren alle MAX 7000-Geräte
– Das serielle BitBlasterTM-Downloadkabel, das ByteBlasterMVTM-Parallelport-Downloadkabel und das MasterBlasterTM-Downloadkabel für den seriellen/universellen seriellen Bus (USB) programmieren MAX 7000S-Geräte
 
Funktionsbeschreibung
Die MAX 7000-Architektur umfasst die folgenden Elemente:
■ Logik-Array-Blöcke
■ Makrozellen
■ Expander-Produktbedingungen (gemeinsam nutzbar und parallel)
■ Programmierbares Verbindungsarray
■ I/O-Steuerblöcke
Die MAX 7000-Architektur umfasst vier dedizierte Eingänge, die als allgemeine Eingänge oder als globale Hochgeschwindigkeitssteuersignale (Takt-, Lösch- und zwei Ausgangsfreigabesignale) für jede Makrozelle und jeden I/O-Pin verwendet werden können.Abbildung 1 zeigt die Architektur der EPM7032-, EPM7064- und EPM7096-Geräte.
 
Abbildung 1. Blockdiagramm der Geräte EPM7032, EPM7064 und EPM7096
 
Abbildung 2 zeigt die Architektur der Geräte MAX 7000E und MAX 7000S
 
Abbildung 2. Blockdiagramm der Geräte MAX 7000E und MAX 7000S
 
 
MAX 7000 5,0-V-Gerät Absolute Höchstwerte

Notiz:
(1) Die minimale DC-Eingangsspannung an den I/O-Pins beträgt –0,5 V und an den 4 dedizierten Eingangspins beträgt –0,3 V. Bei Übergängen können die Eingänge bei Eingangsströmen von weniger als 100 mA auf –2,0 V unterschreiten oder auf 7,0 V überschwingen und Perioden kürzer als 20 ns.
 
 
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