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Feldprogrammierbare Gatteranordnung ICS programmierbare Logik EP2S180F1020C3N FPGA - Stratix II 8970 IOS der Labor742

fabricant:
Hersteller
Beschreibung:
Feldprogrammierbare Gatteranordnung Stratix® II (FPGA) IC 742 9383040 179400 1020-BBGA, FCBGA
Kategorie:
Flash-Speicher IC-Chip
Preis:
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Zahlungs-Methode:
Paypal, Western Union, TT
Spezifikationen
Zahl von Schaltelementen:
179400
Zahl von Logik-Reihen-Blöcken - Labors:
8970
Zahl von I/Os:
Input/Output 742
Betriebsstoff-Spannung:
1,2 V
Minimale Betriebstemperatur:
0 C
Normalbetriebshöchsttemperatur:
+ 70 C
Höhepunkt:

logic integrated circuits

,

programmable logic array ic

Einleitung

Feldprogrammierbare Gatteranordnung ICS programmierbare Logik EP2S180F1020C3N FPGA - Stratix II 8970 IOS der Labor742

Eigenschaften

  • 15.600 bis 179.400 gleichwertiges LEs; sehen Sie Tabelle 1-1

  • Neues und innovatives anpassungsfähiges Logikmodul (ALM), das grundlegende

    Baustein der Architektur Stratix II, maximiert Leistung

    und Ressourcenverwendungs-Leistungsfähigkeit

  • Bis 9.383.040 RAM-Bits (1.172.880 Bytes) verfügbar außen

    Verringerung von Logikbetriebsmitteln

  • TriMatrix-Gedächtnis, das aus drei RAM-Blockgrößen besteht, um einzuführen

    wahres Doppel-hafengedächtnis und Puffer des FIFO (Fifo)

  • Hochgeschwindigkeits-DSP-Blöcke liefern engagierte Durchführung von

    Multiplikatoren (an bis 450 MHZ), multiplizieren-sammeln Funktionen an und

    begrenzte Filter des Antriebwarte (TANNE)

  • Bis 16 globale Uhren mit 24 abstoppenden Betriebsmitteln pro Gerätregion

  • Taktsteuerungskennblöcke stützen dynamisches Uhrnetz aktivieren,

    das Uhrnetze abschalten lässt, um Energie zu verringern

    Verbrauch im Benutzermodus

  • Bis 12 PLLs (vier erhöhten PLLs und acht schnelles PLLs), pro Gerät

    stellen Sie verbreitetes Spektrum, programmierbare Bandbreite, Uhrschalter vorbei, Realzeit-PLL-Rekonfiguration und moderne Vermehrung und die Phasenverschiebung zur Verfügung

  • Unterstützung für zahlreiche unsymmetrische und differenziale Input-/Outputstandards

  • Differenziale Input-/Outputhochgeschwindigkeitsunterstützung mit DPA-Schaltkreis für 1-Gbps

    Leistung

  • Unterstützung für Hochgeschwindigkeitsnetz- und Kommunikationsbus

    Standards einschließlich paralleles RapidIO, SPI-4 Phase 2 (POS-PHY

    Technologie des Niveaus 4), HyperTransportTM und SFI-4

  • Unterstützung für externes Hochgeschwindigkeitsgedächtnis, einschließlich DDR und DDR2

    SDRAM, RLDRAM II, QDR II SRAM und SDR SDRAM

  • Unterstützung für mehrfache geistiges Eigentum megafunctions von

    Funktionen Altera MegaCore® und Partner Altera Megafunction

    Programm (AMPPSM) megafunctions

  • Unterstützung für Entwurfssicherheit unter Verwendung des Konfigurationsbitstroms

    Verschlüsselung

  • Unterstützung für Fernkonfigurationsaktualisierungen

Tabelle 1-1. Familien-Eigenschaften Stratix II FPGA

Eigenschaft

EP2S15

EP2S30

EP2S60

EP2S90

EP2S130

EP2S180

Almosen

6.240

13.552

24.176

36.384

53.016

71.760

Anpassungsfähige Nachschlagentabellen (ALUTs) (1)

12.480

27.104

48.352

72.768

106.032

143.520

Gleichwertiges LEs (2)

15.600

33.880

60.440

90.960

132.540

179.400

Blöcke M512 RAM

104

202

329

488

699

930

Blöcke M4K RAM

78

144

255

408

609

768

M-RAM Blöcke

0

1

2

4

6

9

Gesamt-RAM-Stückchen

419.328

1.369.728

2.544.192

4.520.488

6.747.840

9.383.040

DSP-Blöcke

12

16

36

48

63

96

18-bit × 18 gebissene Multiplikatoren (3)

48

64

144

192

252

384

Erhöhtes PLLs

2

2

4

4

4

4

Schnelles PLLs

4

4

8

8

8

8

Maximale Benutzer Input-/Outputstifte

366

500

718

902

1.126

1.170

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