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Dual-JK-Flip-Flop mit Reset, negativer Flankentrigger 74HC107N,652

fabricant:
NXP
Beschreibung:
Typ 1 Flip Flops 2 Element-JK biss fallende Flanke 14-DIP (0,300", 7.62mm)
Kategorie:
Integrierte Schaltungschips
Preis:
negotiation
Zahlungs-Methode:
T/T, Western Union, Paypal
Spezifikationen
Ertragfähigkeit:
Standard
Kategorie Icc:
Flipflop
Schnellnachweisdaten:
BODEN = 0 V; Tamb = °C 25; tr = tf = 6 ns
WECHSELSTROM-EIGENSCHAFTEN FÜR 74HC:
BODEN = 0 V; tr = tf = 6 ns; CL = 50 PF
WECHSELSTROM-EIGENSCHAFTEN FÜR 74HCT:
BODEN = 0 V; tf = tf = 6 ns; CL = 50 PF
Philips:
-HALBLEITER
Höhepunkt:

electronics ic chip

,

integrated circuit components

Einleitung

 

MERKMALE

                                                            

• Ausgabefähigkeit: Standard

• ICHCCKategorie: Flip-Flop

 

 

ALLGEMEINE BESCHREIBUNG

 

Die 74HC/HCT107 sind Hochgeschwindigkeits-Si-Gate-CMOS-Geräte

und sind pinkompatibel mit Schottky-TTL mit geringem Stromverbrauch

(LSTTL).Sie sind gemäß JEDEC spezifiziert

Standard-Nr.7A.

 

Die Modelle 74HC/HCT107 werden durch eine doppelte negative Flanke ausgelöst

Flip-Flops vom JK-Typ mit individuellem J, K, Takt (nCP) und

Reset-Eingänge (nR);auch komplementäre Q- und Q-Ausgänge.

 

Die J- und K-Eingänge müssen eine Setup-Zeit vorher stabil sein

Der Taktübergang von HIGH nach LOW ist vorhersehbar

Betrieb.

 

Der Reset (nR) ist ein asynchroner aktiver LOW-Eingang.

Bei LOW überschreibt es die Takt- und Dateneingänge und erzwiCM GROUP

der Q-Ausgang LOW und der Q-Ausgang HIGH.

 

Die Schmitt-Trigger-Aktion im Takteingang stellt die Schaltung her

Sehr tolerant gegenüber langsameren Anstiegs- und Abfallzeiten der Uhr.

 

 

KURZREFERENZDATEN

GND = 0 V;Tamb= 25 °C;TR= tF= 6 ns

SYMBOL PARAMETER BEDINGUNGEN TYPISCH EINHEIT
HC HCT
TPHL/ TPLH

Ausbreitungsverzögerung

nCP zu nQ

nCP zu nQ

nR zu nQ, nQ

CL= 15 pF;

VCC= 5 V

 

16

16

16

 

16

18

17

 

ns

ns

ns

Fmax maximale Taktfrequenz 78 73 MHz
CICH Eingangskapazität   3.5 3.5 pF
CPD Verlustleistungskapazität pro Flip-Flop Anmerkungen 1 und 2 30 30 pF

 

 

 

 

 

 

 

 

 

 

 

 

Anmerkungen

 

1. CPDdient zur Bestimmung der dynamischen Verlustleistung (PDin µW):

PD= CPD× VCC2× fi + ∑ (CL× VCC2× fÖ) Wo:

Fich= Eingangsfrequenz in MHz

FÖ= Ausgangsfrequenz in MHz

∑ (CL× VCC2× fÖ) = Summe der Ausgänge

CL= Ausgangslastkapazität in pF

VCC= Versorgungsspannung in V

 

2. Für HC ist die Bedingung VICH= GND zu VCC

Für HCT ist die Bedingung VICH= GND zu VCC− 1,5 V.

 

 

PIN-BESCHREIBUNG

PIN-NR. SYMBOL NAME UND FUNKTION

1, 8, 4, 11

2, 6

3, 5

7

12, 9

13, 10

14

1J, 2J, 1K, 2K

1Q, 2Q

1Q, 2Q

GND

1CP, 2CP

1R, 2R

VCC

synchrone Eingänge;Flip-Flops 1 und 2

ergänzen die Flip-Flop-Ausgänge

echte Flip-Flop-Ausgänge

Masse (0 V)

Takteingang (HIGH-to-LOW, flankengetriggert)

asynchrone Reset-Eingänge (aktiv LOW)

positive Versorgungsspannung

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

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