EPM3128ATC144-10 programmierbare Leiterplatte, programmierbare IC-Chips, programmierbare Logikgerätefamilie

 
MAX 3000A programmierbare Logikgerätefamilie
Merkmale
■ Leistungsstarke, kostengünstige CMOS-EEPROM-basierte programmierbare Logikbausteine ​​(PLDs), die auf einer MAX®-Architektur basieren
■ 3,3-V-In-System-Programmierbarkeit (ISP) durch den integrierten IEEE-Standard.1149.1 Joint Test Action Group (JTAG)-Schnittstelle mit erweiterter Pin-Locking-Funktion – ISP-Schaltkreis konform mit IEEE Std.1532
■ Integrierter Boundary-Scan-Test (BST)-Schaltkreis gemäß IEEE-Standard.1149.1-1990
■ Erweiterte ISP-Funktionen: – Verbesserter ISP-Algorithmus für schnellere Programmierung – ISP_Done-Bit zur Gewährleistung einer vollständigen Programmierung – Pull-up-Widerstand an I/O-Pins während der systeminternen Programmierung
■ PLDs mit hoher Dichte von 600 bis 10.000 nutzbaren Gates
■ 4,5 ns Pin-zu-Pin-Logikverzögerungen mit Zählerfrequenzen von bis zu 227,3 MHz
■ MultiVoltTM I/O-Schnittstelle ermöglicht den Betrieb des Gerätekerns mit 3,3 V, während I/O-Pins mit Logikpegeln von 5,0 V, 3,3 V und 2,5 V kompatibel sind
■ Pinanzahlen von 44 bis 256 in verschiedenen Thin Quad Flat Pack (TQFP), Plastic Quad Flat Pack (PQFP), Plastic J-Lead Chip Carrier (PLCC) und FineLine BGATM-Gehäusen
■ Hot-Socket-Unterstützung
■ Kontinuierliche Routing-Struktur des Programmable Interconnect Array (PIA) für schnelle, vorhersehbare Leistung
■ Industrieller Temperaturbereich
■ PCI-kompatibel
■ Busfreundliche Architektur einschließlich programmierbarer Anstiegsgeschwindigkeitssteuerung
■ Open-Drain-Ausgangsoption
■ Programmierbare Makrozellen-Flipflops mit individuellen Lösch-, Voreinstellungs-, Takt- und Taktfreigabesteuerungen
■ Programmierbarer Energiesparmodus für eine Leistungsreduzierung von über 50 % in jeder Makrozelle
■ Konfigurierbare Expander-Produktbegriffsverteilung, die bis zu 32 Produktbegriffe pro Makrozelle ermöglicht
■ Programmierbares Sicherheitsbit zum Schutz proprietärer Designs
■ Erweiterte Architekturfunktionen, darunter: – 6- oder 10-polige oder logikgesteuerte Ausgangsfreigabesignale – Zwei globale Taktsignale mit optionaler Invertierung – Erweiterte Verbindungsressourcen für verbesserte Routingfähigkeit – Programmierbare Ausgangsanstiegsgeschwindigkeitssteuerung
■ Software-Design-Unterstützung und automatisches Place-and-Route durch die Entwicklungssysteme von Altera für Windows-basierte PCs und Sun SPARCstations sowie HP 9000 Series 700/800-Workstations
■ Zusätzliche Designeingabe- und Simulationsunterstützung durch EDIF 2 0 0- und 3 0 0-Netzlistendateien, Bibliothek parametrisierter Module (LPM), Verilog HDL, VHDL und andere Schnittstellen zu beliebten EDA-Tools von Drittherstellern wie Cadence, Exemplar Logic, Mentor Graphics, OrCAD, Synopsys, Synplicity und VeriBest
■ Programmierunterstützung mit der Altera-Master-Programmiereinheit (MPU), dem MasterBlasterTM-Kommunikationskabel, dem ByteBlasterMVTM-Parallelport-Downloadkabel, dem BitBlasterTM-Seriell-Downloadkabel sowie Programmierhardware von Drittherstellern und jedem In-Circuit-Tester, der JamTM Standard Test and Programming unterstützt Sprachdateien (STAPL) (.jam), Jam-STAPL-Bytecode-Dateien (.jbc) oder Dateien im seriellen Vektorformat (.svf)
Funktionsbeschreibung
Die MAX 3000A-Architektur umfasst die folgenden Elemente:
■ Logik-Array-Blöcke (LABs)
■ Makrozellen
■ Expander-Produktbedingungen (gemeinsam nutzbar und parallel)
■ Programmable Interconnect Array (PIA)
■ I/O-Steuerblöcke
Die MAX 3000A-Architektur umfasst vier dedizierte Eingänge, die als allgemeine Eingänge oder als globale Hochgeschwindigkeitssteuersignale (Takt-, Lösch- und zwei Ausgangsfreigabesignale) für jede Makrozelle und jeden I/O-Pin verwendet werden können.Abbildung 1 zeigt die Architektur der MAX 3000A-Geräte.
Abbildung 1. Blockdiagramm des MAX 3000A-Geräts
Hinweis: (1) Die Geräte EPM3032A, EPM3064A, EPM3128A und EPM3256A verfügen über sechs Ausgangsfreigaben.EPM3512A-Geräte verfügen über 10 Ausgangsfreigaben.
MAX 3000A-Gerät Absolute Höchstwerte

Notiz:
(1) Die minimale DC-Eingangsspannung beträgt –0,5 V. Bei Übergängen können die Eingänge bei Eingangsströmen von weniger als 100 mA und Zeiträumen von weniger als 20 ns auf –2,0 V unterschreiten oder auf 5,75 V überschwingen.
 
 
 
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